maxplusII编译总是有：logic array block E requires too many (45/36) inputs from D

bluerainbow · 发表于 2004-3-15 14:52:40

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应该如何解决呢？多谢！

atuhappy · 发表于 2004-3-15 18:09:09

DIA？是不是PIA
如果是PIA，是布线通不过，布线资源占用太多，换一个规模大一点的器件。

bluerainbow · 发表于 2004-3-15 18:45:34

如果使maxplusII自己配制管脚就可以，有没有手工调整的办法，因为我我的电路板已经制好了。多谢！

atuhappy · 发表于 2004-3-15 19:53:12

在assign－》global project logic synthesis中
使用carry chain和cascade chian试一下

bluerainbow · 发表于 2004-3-16 10:40:02

哦，我试一下，还想再问一个问题：哪里有比较好地maxplus的书记下载？有些maxplus中的基本概念还不是很清楚，比如：lcell之类的。非常感谢！

atuhappy · 发表于 2004-3-16 10:59:54

还是买本书吧

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