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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › 芯片版图面积的设计优化
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楼主: yuecheng

芯片版图面积的设计优化

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yxxjtu
发表于 2010-6-13 21:11:57 | 显示全部楼层
没人顶，俺顶下吧
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yxxjtu
发表于 2010-6-13 21:13:09 | 显示全部楼层
真的不好啊！
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风青杨
发表于 2010-6-14 20:42:40 | 显示全部楼层
谢谢了！！！
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catherine_xu
发表于 2010-7-2 21:18:15 | 显示全部楼层
谢谢！！！
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andrewxj
发表于 2010-8-2 22:28:41 | 显示全部楼层
下来学习下呵呵
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ayamitek
发表于 2010-12-26 18:28:20 | 显示全部楼层
回复 1# yuecheng


       thanks
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fj198462
发表于 2011-1-29 13:17:38 | 显示全部楼层
hao!!!!
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X6J6P6
发表于 2011-1-29 17:49:52 | 显示全部楼层
不错啊，谢谢楼主。
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rainbow_ybyan
发表于 2011-2-8 12:38:58 | 显示全部楼层
thanks
thanks
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hotmax1
发表于 2011-2-8 14:05:00 | 显示全部楼层
顶。。。。。。。。。。。。。。。
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