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楼主: quirinus

用Verilog 实现一个16位超前进位加法器（实例）

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lynn850417
发表于 2009-12-30 17:36:20 | 显示全部楼层
非常感谢 哈哈
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jackal0716
发表于 2010-1-1 19:41:08 | 显示全部楼层
thanks a lot~~
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jackal0716
发表于 2010-1-1 19:42:15 | 显示全部楼层
thanks a lot~~
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jackal0716
发表于 2010-1-1 20:00:52 | 显示全部楼层
thansk al ot~~
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张全利
发表于 2010-1-1 23:32:06 | 显示全部楼层
看看了。。
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qixueli001
发表于 2010-1-2 21:52:03 | 显示全部楼层
谢谢楼主共享！！！！
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pengwillfly
发表于 2010-1-7 09:30:24 | 显示全部楼层
唉，要是有结构图就好了
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create
发表于 2010-1-7 10:17:34 | 显示全部楼层
好的!!!
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zllei
发表于 2010-1-7 10:29:23 | 显示全部楼层
不错 啊
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yangjhua9161
发表于 2010-3-2 23:19:22 | 显示全部楼层
没说明啊，看看
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