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用Verilog 实现一个16位超前进位加法器（实例）

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quirinus
发表于 2009-3-25 15:52:54 | 显示全部楼层 |阅读模式

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用Verilog 实现一个16位超前进位加法器（实例）
法器

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gatezte2008
发表于 2009-4-5 21:40:54 | 显示全部楼层
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ansizhu
发表于 2009-6-18 16:54:27 | 显示全部楼层

谢谢了

好东西啊 谢谢了
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llxmars
发表于 2009-6-29 21:24:34 | 显示全部楼层
看一下，谢谢
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liang786
发表于 2009-9-16 02:25:21 | 显示全部楼层
这个是需要的，就是没有说明，有点可惜
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1232ej
发表于 2009-10-11 15:58:44 | 显示全部楼层
好东西啊 谢谢了
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qian321
发表于 2009-10-12 10:59:29 | 显示全部楼层
godss
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fycom200
发表于 2009-10-14 13:58:57 | 显示全部楼层
好是好，就是要好多回帖才能下
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chq_yanxue
发表于 2009-10-14 14:37:34 | 显示全部楼层
谢谢！！！！！！！！！！！！！！！！！
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lynn850417
发表于 2009-12-30 17:34:59 | 显示全部楼层
非常感谢 哈哈
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