用Verilog 实现一个16位超前进位加法器（实例）

quirinus · 发表于 2009-3-25 15:52:54

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用verilog 实现一个16位超前进位加法器（实例）

gatezte2008 · 发表于 2009-4-5 21:40:54

111111111

ansizhu · 发表于 2009-6-18 16:54:27

好东西啊谢谢了

llxmars · 发表于 2009-6-29 21:24:34

看一下，谢谢

liang786 · 发表于 2009-9-16 02:25:21

这个是需要的，就是没有说明，有点可惜

1232ej · 发表于 2009-10-11 15:58:44

好东西啊谢谢了

qian321 · 发表于 2009-10-12 10:59:29

godss

fycom200 · 发表于 2009-10-14 13:58:57

好是好，就是要好多回帖才能下

chq_yanxue · 发表于 2009-10-14 14:37:34

谢谢！！！！！！！！！！！！！！！！！

lynn850417 · 发表于 2009-12-30 17:34:59

非常感谢哈哈

谢谢了