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楼主: xwlpxc

恳请大家分析下图:一个完整的带隙基准电路图中的一些问题交流请教

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发表于 2009-3-25 12:28:18 | 显示全部楼层
MS2的W/L应该比较大,类似于一个小电阻
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发表于 2009-3-25 14:16:19 | 显示全部楼层
为什么我是无法查看呢
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 楼主| 发表于 2009-3-25 15:50:32 | 显示全部楼层
MS2是26.4um 和0.8um  
图上可以看出
和大家想的一样,确实比较大
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发表于 2009-3-26 21:07:47 | 显示全部楼层
paper上很可能省略一些东西的

稳妥起见还是有个自偏执好点

香港科大的philip有一篇相似的bandgap设计

就是有ibias的
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发表于 2009-3-28 00:53:38 | 显示全部楼层


   
原帖由 xwlpxc 于 2009-3-24 20:12 发表
/ k+ k# G$ \* h2 {6 b  i
这个电路是IEEE的,应该没有错误。
sean_4413:   
可以这样分析:0状态时,所有的nmos管G级都为0,所有的pmos管G级都为vdd。这样MS4的G极电压为vdd,
前面半句可以理解。后面半句很疑惑 ...


这有什么不行的
我就是这样理解的呀,开始时MS2是断开的,MS1却是有源的电阻的连接形式,所以是导通的,这样MS4 的G就会是高电平,所以会有电流流过,从而启动电路
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发表于 2009-3-28 11:25:23 | 显示全部楼层
运放已经有外界偏置了,M5X自然而然的流过PTAT电流,用的着启动吗,这个电路图肯定是不完整的,偏置是自偏置才需要启动。


   
原帖由 adampippo 于 2009-3-28 00:53 发表

这有什么不行的
我就是这样理解的呀,开始时MS2是断开的,MS1却是有源的电阻的连接形式,所以是导通的,这样MS4 的G就会是高电平,所以会有电流流过,从而启动电路

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发表于 2009-3-28 12:02:57 | 显示全部楼层


   
原帖由 sean_4413 于 2009-3-24 18:45 发表
当通以vdd时,电路可能稳定在0状态,所以需要启动电路。
可以这样分析:0状态时,所有的nmos管G级都为0,所有的pmos管G级都为vdd。这样MS4的G极电压为vdd,MS4
管导通,提供电流给MS3,MS5复制MS3电流,这样R2X电压 ...


这样理解不正确。左边的是启动电路。上电时,由于二极管的作用,左下角管子截止,电路启动成功。电路进入正常状态时,左下角管子导通,启动电路关断,电路正常工作。
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发表于 2009-3-29 17:36:39 | 显示全部楼层


   
原帖由 martiny3 于 2009-3-28 12:02 发表

这样理解不正确。左边的是启动电路。上电时,由于二极管的作用,左下角管子截止,电路启动成功。电路进入正常状态时,左下角管子导通,启动电路关断,电路正常工作。



你仔细看看我的留言,如果看懂了,我觉得更容易理解启动电路了,我的很直观的
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发表于 2009-3-30 14:41:51 | 显示全部楼层
ding yi ge ba
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发表于 2009-3-30 18:45:55 | 显示全部楼层
启动完成后,启动电路就不该对主电路产生影响,所以我估计Q3X目的就是认为多加一个BE压降,提高左下管的VGS,进一步保证该管的负载仍为MS1时,VDS足够小,从而保证启动电路不对主电路产生影响
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