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楼主: 混频器设计

运放建立时间的计算 (need help)

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 楼主| 发表于 2009-3-19 02:20:27 | 显示全部楼层
一阶系统阶跃响应?  汗了 信号系统全丢了

sigma delta ad不是挺火的么  怎么牛人都不在啊
 楼主| 发表于 2009-3-19 17:18:13 | 显示全部楼层
顶下 等大牛继续释疑
发表于 2009-3-19 17:18:33 | 显示全部楼层
Will it be different , if the amplifier is used in the oversampling a/d convertor
发表于 2009-3-20 11:45:08 | 显示全部楼层
BW is the bandwidth of the close loop, it depends on how you use the opamp
 楼主| 发表于 2009-3-20 16:38:21 | 显示全部楼层
Thanks for replying

The amplifier is used in a sigma delta AD, as I told before.
So it works as an integrator.
发表于 2009-3-23 11:12:06 | 显示全部楼层
2阶系统阶跃响应k
发表于 2009-3-24 09:14:04 | 显示全部楼层
静态误差要求越低,开环增益需要越大,反馈系数越低,相同的静态误差下,开环增益需要越大
 楼主| 发表于 2009-3-24 18:36:15 | 显示全部楼层
没有准确的公式么
过采样率对它影响是什么
发表于 2009-3-24 21:09:25 | 显示全部楼层
对于1阶系统,如前面所述,按照指数上升,时间常数为1/(2pi*GBW)(GBW为闭环),因此GBW越大,settling time越短
对于2阶系统(无零点),如果wp2>4GBW,那么settling函数为两个指数函数相减,一个时间常数为1/(2pi*GBW),一个为1/(wp2),但上升要比一阶来得快;如果wp2<4GBW,将会出现过冲,damping factor=wp2/2,因此wp2越大,settling越快。
如果出现零点,根据左半平面或者右半平面,会恶化或者加快settling
发表于 2009-3-24 21:11:10 | 显示全部楼层
从settling角度出发,wp2=4GBW是settling最快的时候,但是这样两级运方比较耗电, 设计时可以取wp2=3GBW,此时对应PM~72degree,而引入的瞬态overshoot很小。
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