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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › Verification Methodology Manual for SystemVerilog.

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楼主: wuhuhusong

Verification Methodology Manual for SystemVerilog.

发表于 2010-7-30 21:59:02 | 显示全部楼层

3ku!!!!!!!!!!!

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发表于 2010-9-7 20:06:26 | 显示全部楼层

经典啊!!!!

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发表于 2010-9-7 21:16:40 | 显示全部楼层

thanks ～

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发表于 2010-9-14 01:28:15 | 显示全部楼层

good 好書

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发表于 2010-9-14 07:05:40 | 显示全部楼层

好东西啊，看过中文的

畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！

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发表于 2010-9-15 04:27:34 | 显示全部楼层

这个和http://bbs.eetop.cn/viewthread.p ... p;extra=&page=1 4#中的附件有什么区别啊？楼主能给予解释一下吗？

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发表于 2010-9-15 09:57:10 | 显示全部楼层

thanks!

畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！

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发表于 2010-9-15 10:59:41 | 显示全部楼层

very good

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发表于 2010-9-16 17:51:05 | 显示全部楼层

zhegeyoule

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发表于 2010-9-16 22:06:27 | 显示全部楼层

仿真sv用什么软件好呢？

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