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请教大虾:是不是CPLD很容易受到干扰?...

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发表于 2004-2-27 22:18:36 | 显示全部楼层 |阅读模式

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我用ALTERA公司的EPM7064S设计一种仪表,去做电磁兼容试验时,发现通过7064输出的逻辑状态在干扰脉冲到来时混乱,而以前同样的东西(只是不用EPM7064S)就没问题,是不是这类芯片容易受到干扰,又如何解决,请大虾赐教,在下不胜感激?
发表于 2004-2-27 22:23:35 | 显示全部楼层

请教大虾:是不是CPLD很容易受到干扰?...

去藕电容要加好,电源滤波,如果采用开关电源最好选一个看共摸干扰强的
必要时加光隔离(由你的应用来定)
 楼主| 发表于 2004-2-27 23:05:33 | 显示全部楼层

请教大虾:是不是CPLD很容易受到干扰?...

请教坛主,是不是每个电源的引脚上都要加去藕电容?我记得我的板子上7064的所有电源引脚用了很宽的连线连起来的.
发表于 2004-2-27 23:21:36 | 显示全部楼层

请教大虾:是不是CPLD很容易受到干扰?...

没一个vcc pin上都需要
 楼主| 发表于 2004-2-27 23:47:08 | 显示全部楼层

请教大虾:是不是CPLD很容易受到干扰?...

多谢坛主教诲!
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