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查看: 6674|回复: 11

请教一下:关于sansen的analog design essentials上的问题

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发表于 2009-2-24 19:35:39 | 显示全部楼层 |阅读模式

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在这本书第二章的cascodes中的0251中,sansen提到一个问题:晶体管电流ids随着负载电阻的增加而增加.

我想请问:有什么方法可以直观的看出来吗?谢谢
0251.bmp
发表于 2009-2-24 20:45:05 | 显示全部楼层
我想应该是这个意思: 当RL 增大时,vout减小,导致流过rds的电流变小,而电流源没有改变,那么流过mos得电流就增大了。
发表于 2009-2-24 21:14:56 | 显示全部楼层
恩,看图解题
发表于 2009-2-25 15:33:51 | 显示全部楼层
呵呵 从Rout上考虑会直观些……

下面parts自身的电阻和RL的电阻并联,
当RL和下面自身构成的电阻相当时,RL的作用逐渐变弱,Gain趋于恒定, VOUT趋于恒定
RL增大,当然流经它的电流逐渐减小…… 那哪部分电流增加呢?

试想一下当ROUT趋于无穷大时,那不是相当于开路,最大增益为多少呢


呵呵,一些问题你在仔细捉摸一下,就可明白为什么IDS增大了

[ 本帖最后由 m2ic 于 2009-2-25 15:38 编辑 ]
发表于 2009-2-25 15:36:00 | 显示全部楼层
加电流源仿真
头像被屏蔽
发表于 2009-2-25 16:20:21 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
 楼主| 发表于 2009-2-25 17:03:15 | 显示全部楼层


原帖由 m2ic 于 2009-2-25 15:33 发表
呵呵 从Rout上考虑会直观些……

下面parts自身的电阻和RL的电阻并联,
当RL和下面自身构成的电阻相当时,RL的作用逐渐变弱,Gain趋于恒定, VOUT趋于恒定
RL增大,当然流经它的电流逐渐减小…… 那哪部分电流增 ...



非常感谢,想通了,我老是从输入端去想,怎么也没有想通.谢谢了!
发表于 2009-2-26 09:42:19 | 显示全部楼层
楼上在搞啥子???
发表于 2009-3-2 16:12:45 | 显示全部楼层
  ~!!  ftrr  tt
发表于 2009-3-2 21:35:06 | 显示全部楼层
把你的中文版本上传一下阿,谢谢阿
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