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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › VerilogHDL及其Testbench编写方法
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楼主: maxidy

VerilogHDL及其Testbench编写方法

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tomchen_2003
发表于 2011-1-19 17:33:15 | 显示全部楼层
it's very cool!
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zhuhuren
发表于 2011-1-27 22:50:09 | 显示全部楼层
下下来看看 非常感谢
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yongenchen
发表于 2011-2-23 17:57:15 | 显示全部楼层
thanks a lot
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frog198
发表于 2011-2-26 17:49:31 | 显示全部楼层
挺好的，谢谢！
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jaiman
发表于 2011-3-1 21:29:28 | 显示全部楼层
傻傻分不清楚~謝~
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seekerbjtu
发表于 2011-3-1 22:48:33 | 显示全部楼层
回复 1# maxidy


  谢了，正好最近用
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wsxingshi
发表于 2011-3-3 10:54:19 | 显示全部楼层
thanks a lot
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kanks123
发表于 2011-4-3 23:46:15 | 显示全部楼层
thanks for sharing
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happy_886
发表于 2011-5-16 05:01:09 | 显示全部楼层
thanks for sharing
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yuwu131
发表于 2011-5-16 08:10:50 | 显示全部楼层
学习学习
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