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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 设计与验证Verilog_实例(中文注释)
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楼主: sun_ic

设计与验证Verilog_实例(中文注释)

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发表于 2010-3-11 15:31:03 | 显示全部楼层
感谢共享！
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发表于 2010-5-27 11:48:11 | 显示全部楼层
支持~~~
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发表于 2010-6-1 20:52:22 | 显示全部楼层
good material
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发表于 2010-6-2 00:58:34 | 显示全部楼层
穷疯了吧
这也可以。。。。
还不如你直接贴出来的好
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发表于 2010-6-10 21:57:18 | 显示全部楼层
hao dxi a  a
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发表于 2011-11-26 16:57:23 | 显示全部楼层
刚开始学verilog，谢谢LZ
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发表于 2011-11-30 15:45:32 | 显示全部楼层
正在寻找，十分感谢
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发表于 2012-7-29 00:26:32 | 显示全部楼层
thank you very much
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发表于 2012-7-30 11:11:48 | 显示全部楼层
学习学习···········
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ys.jan
发表于 2013-3-27 19:36:10 | 显示全部楼层
非常好
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