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问 Verilog arms 是用来干什么的,和VerilogA区别?

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发表于 2008-10-17 16:59:21 | 显示全部楼层 |阅读模式

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Veriloga 用来做系统级建模  
Verilog arms是用来干什么的呢?
头像被屏蔽
发表于 2008-10-17 20:32:33 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
发表于 2010-12-20 17:58:40 | 显示全部楼层
是verilog .vams吧
发表于 2010-12-22 19:04:55 | 显示全部楼层
mixed signal
发表于 2010-12-25 18:12:51 | 显示全部楼层
I guess it is typographical error.
Verilog-AMS.
Refer to the URL for more information:
http://en.wikipedia.org/wiki/Verilog-AMS
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