笔试题，求大神解答，弄不懂什么意思

battyson · 发表于 2016-6-27 16:01:08

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A时钟域工作在1Mhz，B时钟域的工作频率在（100Mhz,200Mhz）范围，具体的工作频率不定，两个时钟域是非同源时钟；B时钟域有一个单周期脉冲信号（这种脉冲出现的频率非常低，低于10hz）需要传输到A时钟域，在A时钟域恢复出等于A时钟一个周期长的脉冲信号；用verilog写出实现代码。
PS：主要弄不懂要干什么，没有一点思路

菜鸟要飞 · 发表于 2016-6-27 16:10:40

时钟域转换，从快时钟域转到慢时钟域，用FIFO就可以

杰克淡定 · 发表于 2016-6-27 16:24:48

搜索我最近发的帖子：verilog基本电路设计之一（单bit跨时钟域同步）

battyson · 发表于 2016-6-27 16:38:49

回复 3# 杰克淡定

恩我去看看谢谢大神

battyson · 发表于 2016-6-27 16:47:29

回复 3# 杰克淡定

找不到呢，给发个衔接好吗，

杰克淡定 · 发表于 2016-6-27 16:59:29

回复 5# battyson

没用过论坛搜索功能？上排“搜索”按钮就是了。链接如下：

http://bbs.eetop.cn/thread-605419-1-1.html

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