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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 数字锁相环（Verilog）
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楼主: dfsmile

数字锁相环（Verilog）

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发表于 2008-9-18 01:44:25 | 显示全部楼层
很好奇, 真得的可以用嗎? 下載回來研究研究,
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gmj888
发表于 2008-9-18 09:46:53 | 显示全部楼层
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发表于 2008-9-18 09:49:13 | 显示全部楼层
Thanks a lot!
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lxgherb
发表于 2008-9-18 18:29:37 | 显示全部楼层
看看!谢谢
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发表于 2008-9-18 20:04:48 | 显示全部楼层
通信里的吗
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发表于 2008-10-5 01:55:01 | 显示全部楼层
正要学呢，呵呵
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发表于 2008-10-6 00:56:46 | 显示全部楼层
看看先
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发表于 2008-10-7 09:11:18 | 显示全部楼层
thanks.
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发表于 2008-10-7 18:16:42 | 显示全部楼层
2kan kan
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jcchan
发表于 2008-10-8 15:32:55 | 显示全部楼层
很好的資料，感謝大大無私的分享。
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