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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › SystemVerilog IEEE Std 1800-2007
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楼主: immonster

SystemVerilog IEEE Std 1800-2007

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aljuied
发表于 2010-2-24 11:12:42 | 显示全部楼层
谢谢了！！！
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uranium
发表于 2010-4-2 23:59:03 | 显示全部楼层
顶楼主，找了好久了，IEEE的东西真是又贵又难搞到
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ddale
发表于 2010-4-3 22:29:25 | 显示全部楼层
太好了!!!
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coyboy
发表于 2010-5-3 14:25:39 | 显示全部楼层
谢谢，很感谢
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发表于 2010-5-3 18:58:06 | 显示全部楼层
好像最新的是2009
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发表于 2011-3-29 15:11:58 | 显示全部楼层
tks very much
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发表于 2011-4-1 21:34:06 | 显示全部楼层
非常很好
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falinx
发表于 2011-6-22 00:43:53 | 显示全部楼层
THX~~~ !!!
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zzczx
发表于 2011-11-16 17:02:07 | 显示全部楼层
07的标准，谢谢。不知道现在一般浏览器支持哪些最多
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