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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › SystemVerilog IEEE Std 1800-2007
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楼主: immonster

SystemVerilog IEEE Std 1800-2007

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foolish
发表于 2009-7-3 00:03:18 | 显示全部楼层
好好学习
天天向上
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jxli99
发表于 2009-8-13 16:27:56 | 显示全部楼层
不错,这个资料来得很及时。
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jxli99
发表于 2009-8-13 16:34:39 | 显示全部楼层
下载不成功，钱却扣了。
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发表于 2009-8-14 23:16:28 | 显示全部楼层
thanks
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发表于 2009-8-17 17:15:37 | 显示全部楼层
非常感谢楼主，这个标准好像还在修订中，找了很久了
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ape326
发表于 2009-9-17 16:01:48 | 显示全部楼层
tks for your sharing
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linguist
发表于 2009-12-23 12:00:38 | 显示全部楼层
正需要 多谢
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goldlist
发表于 2009-12-29 21:30:31 | 显示全部楼层
very good book
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发表于 2010-1-15 12:24:11 | 显示全部楼层
有没有2009版本的呀？
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发表于 2010-2-24 09:38:00 | 显示全部楼层
Thanks very much~
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