crossing clock domains of derived clocks?

mediavision · 发表于 2008-5-28 13:31:28

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clock signals clk_12MHZ, clk_6MHZ and clk_3MHZ are derived from clk_48MHZ through synchronous counter, is it necessary to consider the clock-domain-crossing synchronization when communicating data between these clock domains?

eric_luo · 发表于 2008-5-28 15:23:45

不用！
应该是一个时钟域

MOSFET · 发表于 2008-5-28 15:33:02

仍属于同步
有固定相位关系

yangyuf · 发表于 2008-5-29 00:43:31

但是还须后段place&route保证三个时钟之间的skew不能太大。

rfvns · 发表于 2008-6-1 02:03:33

我也有同一問題, 請問place & route 的 timing constraint 應該如何寫來控制skew?

tf_summer · 发表于 2008-6-1 09:20:25

不敢苟同，lz你从counter出1/x时钟，时钟之间肯定相位差没有特定关系

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