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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › vhdl 设计数字钟

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楼主: empmit

vhdl 设计数字钟

发表于 2009-4-29 18:12:31 | 显示全部楼层

好！！！！！！！！！！！！！！！

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发表于 2009-5-4 16:41:06 | 显示全部楼层

Ddddddddddddddddddddd

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发表于 2009-5-6 15:25:11 | 显示全部楼层

程序已经坏了

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发表于 2009-5-8 15:23:35 | 显示全部楼层

顶啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊

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发表于 2009-6-1 21:28:47 | 显示全部楼层

ding ding!

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发表于 2009-6-12 06:22:28 | 显示全部楼层

Thanks a lot!!!8

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发表于 2009-6-12 06:24:57 | 显示全部楼层

不错，谢谢楼主。

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发表于 2009-6-13 00:02:03 | 显示全部楼层

谢谢楼主

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发表于 2009-7-5 19:44:20 | 显示全部楼层

谢谢啊

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发表于 2009-8-5 11:31:50 | 显示全部楼层

我也想学学~~~

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