二阶sigma delta ADC modulator低频噪声大的问题

asu2011 · 发表于 2014-4-28 20:31:04

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本帖最后由 asu2011 于 2014-4-28 20:40 编辑

在做一个二阶2bit的sigma delta ADC， CIFB结构，matlab建模的snr可以达到85dB左右，在cadence里面用理想放大器构成的积分器，理想的DAC，还有ladder flash ADC，bandwidth=200KHz，osr=80，fs=32MHz，fin=101*fs/2^14，coherent sampling，但是cadence里面最后moudulator的输出导入matlab计算snr。

1 如图，第一张图和第二张图，可以明显的看到在接近dc的那几个bin的noise明显很大，导致最后算出的snr很小，去掉那几个bin可以得到snr达到70多dB。我想问的是有什么原因导致的低频下的噪声很大呢？我之前看过一些帖子，也没整明白，说的是有可能是积分器里面的gain bandwidth和slew rate的问题还有dac反馈的问题，我都试了，还是没能解决掉。

2 图3，从fft分析的频谱来看，明显的存在着频谱泄露的情况，这又是什么原因呢？（采样点事严格按照coherent samping来选取的），有哪些因素可以导致频谱泄露呢？放大器的非线性?我的放大器是verilog——a代码写的，怎么来改善它的线性度呢？

最后一个图是和matlab建模输出的fft的比较。
困扰了好久，谢谢大家，踊跃讨论！

hanyongchunsd · 发表于 2022-1-9 11:18:17

quantus 发表于 2014-7-8 21:17
回复 5# asu2011
modulator如果用01，积分器很容易饱和，这一点在高阶SDM中特别明显。如果用simulink来做 ...

楼主请问怎么用MATLAB处理多位处理器的数据啊,我不知道怎么话频谱图需不需要归一化处理

jeffej · 发表于 2020-3-31 09:42:57

learn much from eetop !!!

chafenfa · 发表于 2016-10-10 16:05:20

楼主，请问从cadence中导出了modulator仿真数据，在matlab中进行fft变换时的matlab程序该怎么写呀？是不是与一般的数据做fft变换不同，要考虑到OSR的问题，要把过采样频率转换为奈奎斯特频率呢?具体应该怎么呢？多谢

冷漠-真理 · 发表于 2016-2-19 10:38:29

回复 15# asu2011

楼主也给我发个simulink的模型截图我的邮件时1045181788@qq.com谢谢

spartan313 · 发表于 2015-9-18 11:09:46

回复 15# asu2011

特别感谢！！！不急等你空就好谢谢！！！！！！！！！！！！

asu2011 · 发表于 2015-9-18 09:43:43

回复 14# geo24

好的等我抽空截个图

spartan313 · 发表于 2015-9-18 02:25:08

回复 13# asu2011

我卡了很久介意发我看看你的 simulink的模型么我的邮件时geonj24@gmail.com如果不行能发个截图给我看看么？
谢谢啊

asu2011 · 发表于 2015-9-17 11:01:58

回复 12# geo24

是的，我是用的这个

spartan313 · 发表于 2015-9-17 06:53:42

楼主你好，我按照的 Understanding DS DATA converter里面320页的结构搭的
二阶1bit的sigma delta ADC， CIFB结构,simulink里建模

2nd Order 1 bit CT-DSM

我的疑问是对于DAC 是用zero order hold模块？

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