数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 11 |主题: 30174|排名: 12

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[讨论] vivado	scutlee 2024-5-10	0127	scutlee 2024-5-10 14:50
[讨论] 用vivado做bifile debug	scutlee 2024-5-10	0127	scutlee 2024-5-10 21:32
[讨论] vivado 调用ila ，怎么会缺失文件？？？	scutlee 2024-5-9	4173	scutlee 2024-5-11 09:47
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[讨论] clock gate 的 enable 信号需要同步吗？？	scutlee 5 天前	2142	scutlee 4 天前
[讨论] vivado 的 synth.elab.expandBusRegLimit	scutlee 2024-5-8	2103	scutlee 2024-5-10 11:05
[讨论] vivadode vio和ila是什么关系？？	scutlee 5 天前	1107	shiyinjita 4 天前
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[讨论] 为啥我的vivado的波形只有100ns	scutlee 6 天前	2112	silent_speak 5 天前
[讨论] vivado是不是可以配置代码特定信号的值	scutlee 2024-5-10	3129	ilmkduse 2024-5-10 17:32
[讨论] vivado 的ILA不在最顶层例化可以吗	scutlee 4 天前	1104	waniwa 4 天前
[讨论] vivado的warning	scutlee 2024-5-10	2115	774110102 2024-5-11 09:30
[讨论] 一片FPGA芯片能例化几个ILA,MMCM,PLL和VIO？？？？？？	scutlee 3 天前	190	Wade_ 3 天前
[讨论] 关于vivado的ILA 和chipscope	scutlee 7 天前	180	拾冠 6 天前
[讨论] 如何在IP设计层面预估功耗？ - [阅读权限 30]	luoyanghero 2020-3-27	034	luoyanghero 2020-3-27 10:24
[讨论] vivado一直卡在technology mapping是怎么回事？？？	scutlee 2024-5-7	093	scutlee 2024-5-7 09:40
[讨论] vivado 的 get_pins能找到，但是综合的时候就说没找到什么原因呢？？	scutlee 2024-5-9	076	scutlee 2024-5-9 09:49
[讨论] vivado的mmcm问题	scutlee 2024-5-10	089	scutlee 2024-5-10 18:01
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