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查看: 625|回复: 1

[求助] system verilog 压缩结构体

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zlwu
发表于 2023-9-25 23:25:54 | 显示全部楼层 |阅读模式

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求问 system Verilog中压缩结构体 struct packed {} 有位宽限制吗？32bits or 64bits ？
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zhangdeshuai
发表于 2023-9-28 14:39:29 | 显示全部楼层
有没有不知道，我用过有几千bit的
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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