诡异的PLL

windwithgone · 发表于 2016-8-10 16:41:23

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如图，当PLL锁定后，待了一段时间后失锁，然后又锁定，坑爷啊！有谁知道原因吗？

chenximing · 发表于 2016-8-10 17:03:12

环路没问题啊。你还是查查哪个节点抖动了没。

windwithgone · 发表于 2016-8-10 17:09:40

回复 2# chenximing
仿真时所有的模块都是行为级，最简单的整数PLL，外加激励只有直流电源和参考频率，不存在哪个节点中途发生抖动啊？

vint019 · 发表于 2016-8-11 00:38:53

再檢查看看你撰寫的行為模塊在14us時會發生問題嗎?
或者直流电源和参考频率在14us時會發生抖動嗎?

windwithgone · 发表于 2016-8-11 14:16:53

回复 4# vint019
没有啊......
见了鬼了......

alhoceima111 · 发表于 2016-8-11 14:20:08

asdwasdd

windwithgone · 发表于 2016-8-11 14:41:15

回复 6# alhoceima111
什么意思啊

windwithgone · 发表于 2016-12-24 09:55:50

哈哈，小朋友，我来终结此贴吧！是这样的，当系统趋于稳定后，cadence就会把step给relax掉，这样accuracy就失去了，而脱离稳态后，step又会减小。为了消除这种情况，可以加一句bound_step。

liuzexue · 发表于 2016-12-24 22:25:46

回复 8# windwithgone

这个加一句是指在哪里加？

windwithgone · 发表于 2016-12-26 09:21:54

回复 9# liuzexue
加在VCO里面

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