Xilinx FPGA入门连载78：LCD驱动说明

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Xilinx FPGA入门连载78：LCD驱动说明

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1 功能简介

LCD的接口时序波形如图所示。VSYNC是场同步信号，低电平有效，从时序图可以看出，VSYNC是每一场（即也可以理解为每送一幅完整图像）的同步信号；与此类似，HSYNC是行同步信号，也是在每一行数据传输的开始产生几个时钟周期的低脉冲。这两个信号用于同步当前的数据信号，根据固定的脉冲约定，我们在某些时钟上升沿前将图像数据送到数据总线上供LCD内部锁存。

如表所示，这是LCD时序图中对应的时间参数。

信号	列项	标记	最小值	标准值	最大值	单位
Dclk[size=10.5000pt]	频率[size=10.5000pt]	Tosc[size=10.5000pt]		156[size=10.5000pt]		ns[size=10.5000pt]
	最大时间[size=10.5000pt]	Tch[size=10.5000pt]		78[size=10.5000pt]		ns[size=10.5000pt]
	最小时间[size=10.5000pt]	Tcl[size=10.5000pt]		78[size=10.5000pt]		ns[size=10.5000pt]
Data[size=10.5000pt]	建立时间[size=10.5000pt]	Tsu[size=10.5000pt]	12[size=10.5000pt]			ns[size=10.5000pt]
	保持时间[size=10.5000pt]	Thd[size=10.5000pt]	12[size=10.5000pt]			ns[size=10.5000pt]
Hsync[size=10.5000pt]	周期[size=10.5000pt]	TH[size=10.5000pt]		408[size=10.5000pt]		Tosc[size=10.5000pt]
	脉冲宽度[size=10.5000pt]	THS[size=10.5000pt]	[size=10.5000pt]5[size=10.5000pt]	30[size=10.5000pt]		Tosc[size=10.5000pt]
	后沿[size=10.5000pt]	THB[size=10.5000pt]		38[size=10.5000pt]		Tosc[size=10.5000pt]
	显示周期[size=10.5000pt]	TEP[size=10.5000pt]		320[size=10.5000pt]		Tosc[size=10.5000pt]
	同步周期[size=10.5000pt]	THE[size=10.5000pt]	36[size=10.5000pt]	68[size=10.5000pt]	88[size=10.5000pt]	Tosc[size=10.5000pt]
	前沿[size=10.5000pt]	THF[size=10.5000pt]		20[size=10.5000pt]		Tosc[size=10.5000pt]
Vsync[size=10.5000pt]	周期[size=10.5000pt]	TV[size=10.5000pt]		262[size=10.5000pt]		TH[size=10.5000pt]
	脉冲宽度[size=10.5000pt]	TVS[size=10.5000pt]	[size=10.5000pt]1[size=10.5000pt]	[size=10.5000pt]3[size=10.5000pt]	[size=10.5000pt]5[size=10.5000pt]	TH[size=10.5000pt]
	后沿[size=10.5000pt]	TVB[size=10.5000pt]		15[size=10.5000pt]		TH[size=10.5000pt]
	显示周期[size=10.5000pt]	TVD[size=10.5000pt]		240[size=10.5000pt]		TH[size=10.5000pt]
	前沿[size=10.5000pt]	TVF[size=10.5000pt]	[size=10.5000pt]2[size=10.5000pt]	[size=10.5000pt]4[size=10.5000pt]		TH[size=10.5000pt]