如何减少FIFO 的输出延时

zm19830216 · 发表于 2011-1-16 11:00:53

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使用fifo时，fifo至少需要1个时钟才能出数据，如何减少FIFO 的输出延时

alexpanait · 发表于 2011-1-16 21:59:47

good info. thx

jefffree · 发表于 2011-1-28 16:11:09

deng dai hui da

javasun · 发表于 2011-5-6 14:17:19

fullthrought fifo

ricvadim · 发表于 2020-3-19 08:30:05

很好的话题，非常感谢

Mr.nothing · 发表于 2020-3-19 09:42:06

Xilinx的FIFO IP可以设置成first word fall through模式，没有读延时

limingrushui · 发表于 2020-3-19 11:47:29

是不是信号跨越时钟为了防止亚稳态，一般就要打两个以上拍子，参考下：
https://www.cnblogs.com/woshitia ... /12/07/2806966.html
1.4输出状态标记和潜伏期

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