关于信号延时的扩展问题，棘手

ladiy · 发表于 2010-12-17 20:58:04

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我要用Quartus设计一个周期信号延时模块，实现如下图
无标题.jpg

信号在周期内，输出信号上升沿比原信号延时t，延时的时间是步进的。想了很久也试了很多，求教各位帮忙。

ladiy · 发表于 2010-12-17 23:08:25

我想的是用一个时钟，还有一个与主信号相关的复位清零时钟，一起控制计数器，脉宽可以不一样，还有第一个输出不一定没延迟，主要是在步进的思路我理不清，谁能说详细点呢？

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