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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › IC Compiler write verilog问题
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查看: 3897|回复: 4

[求助] IC Compiler write verilog问题

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发表于 2014-11-5 12:35:13 | 显示全部楼层
不行的, ICC必須Uniquify,
所以會被rename掉,

而且rename這個步驟應該是發生在DC write_netlist,
否則ICC應該是根本無法繼續.
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