关于LVS验证中电阻报错的问题

liqiangsjtu · 发表于 2013-12-9 21:15:12

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为了抽取一下电阻的阻值，于是就画了一个很简单的电阻。
做LVS验证的时候报错 property error“property W not found on”

查看 source netlist里面的写法是 R0 vdd！ gnd！ 10K $[RP]

而Layout netlist里面的写法是 R0 VDD！ GND！ 9842.86 L=2.6e-05 W=1.4e-06 $[YS] $X=2000 $Y=800 $D=25

请问报这个错误，是因为在source netlist中没有W和L值么？还是说抽取的电阻值和schematic里面定义的电阻值差距过大造成的？

先谢过了！

liqiangsjtu · 发表于 2013-12-10 21:48:00

回复 2# hszgl
懂了，那就是说，其实我在从layout中提取出来的网表中，把W和L的值删掉也是一样的效果了？

liqiangsjtu · 发表于 2013-12-10 21:50:22

回复 3# kwankwaner

查看了LVS的rule文件，里面关于电阻的语句里面有trace 电阻的阻值和W的值。但schematic中提取的网表中，电阻的属性是没有W和L的值的，所以就会报错说W找不到。

liqiangsjtu · 发表于 2013-12-11 12:57:00

回复 6# hszgl

懂了，多谢解答~

liqiangsjtu · 发表于 2013-12-12 19:52:50

回复 6# hszgl

请教一下，刚刚查看一下setup里面的选项，并没有找到关于W、L设置的东东。。。

liqiangsjtu · 发表于 2013-12-12 19:53:21

回复 7# liqiangsjtu

请教一下，刚刚查看一下setup里面的选项，并没有找到关于W、L设置的东东。。。キャプチャ.JPG

liqiangsjtu · 发表于 2013-12-13 11:34:49

回复 10# hszgl

难道是在 Gates选项中选 turn gate recogntion off么？キャプチャ.JPG

求大神明示~~

liqiangsjtu · 发表于 2013-12-15 20:26:02

回复 12# hszgl

好的，多谢

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