数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 30966|排名: 12

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请问一个work库的问题	micronsun 2004-9-1	12812	showting 2004-9-3 19:31
有谁用FPGA实现过100BASE-T传输，有问题请教 (无内容)	sccgjchn 2004-9-3	08739	sccgjchn 2004-9-3 18:19
板主求救,有关modelsim 与ISE的仿真	hypee 2004-9-3	53454	hypee 2004-9-3 17:01
关于Verilog HDL的开发工具？	crazy 2004-9-1	41968	tonyliu76 2004-9-3 13:49
太好了，又找到了一个好论坛，大家以及努力啊 (无内容)	roamer007 2004-9-2	11967	atuhappy 2004-9-2 11:43
如何在Advantage6.1中增加synplifypro的自动综合呢？ (无内容)	八部众生 2004-9-2	01818	八部众生 2004-9-2 09:50
有没有STARTUP_VIRTEX2 这个启动库符号啊？（无内容） (无内容)	fredu 2004-9-1	01724	fredu 2004-9-1 19:59
问：altera与xilinx的unisim库相对应的是什么库啊？	showting 2004-9-1	05102	showting 2004-9-1 19:29
求助SHARP STN LCD驱动时序的CPLD实现？	willing 2004-9-1	15550	atuhappy 2004-9-1 15:05
FFT ASIC 芯片典型应用	inside 2004-8-13	14728	greatrebel 2004-8-31 22:39
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ise5.x中仿真波形的生成问题?	yanglei 2004-8-31	01747	yanglei 2004-8-31 14:43
请教一个std_logic_textio与synplify综合问题	micronsun 2004-8-31	12860	atuhappy 2004-8-31 12:08
cou core	tonyliu76 2004-8-30	02501	tonyliu76 2004-8-30 17:51
哪位做过DMA controller	atuhappy 2004-8-30	52079	yn800323 2004-8-30 16:43
求Design for Test/Manufacturing方面的书，万分感谢！！ (无内容)	goodhope 2004-8-30	01970	goodhope 2004-8-30 11:08
我问一个关于给pci加iobuf的问题	yn800323 2004-8-29	01904	yn800323 2004-8-29 19:47
急切求助:SE54的timing_driven的布局布线方法	hitlzh 2004-8-11	22247	hitlzh 2004-8-29 13:06
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再问一个问题，关于SYNPLIFY综合的一个警告	wjx197733 2004-8-25	33146	brotherjam 2004-8-28 01:22
USB 设计中的疑问？？	ttlgate 2004-8-27	22227	ttlgate 2004-8-28 01:07
输出为U态是什么原因？	cybernauts 2004-8-26	11851	atuhappy 2004-8-26 17:40
请推荐一本清楚讨论流水线设计的Verilog教材	craftfox 2004-8-26	02577	craftfox 2004-8-26 17:13
为什么功能仿真能实现的到了时序仿真波形就出错了呢？ ...2 3	cybernauts 2004-8-24	217874	cybernauts 2004-8-26 10:04
请问：如何在综合时使用第三方的库，如library xilinxcorelib	micronsun 2004-8-24	12534	bravelu 2004-8-24 22:21
HELP 我想知道verilog中读内存文件的格式	hypee 2004-7-20	64521	abull 2004-8-23 17:31
请问一个IO口定义为 inout时，信号冲突的问题	wunone 2004-8-19	43606	foxcom 2004-8-23 10:04
求助：LABs是什么意思	zhdang 2004-8-20	217994	liuiang 2004-8-23 08:54
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