请教如下要求的clock在pt中应该怎么create

nicholas08 · 发表于 2011-12-8 10:56:02

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本帖最后由 nicholas08 于 2011-12-9 11:47 编辑

我现在一个source clk会经过好多的clock module产生不同的clk给不同的module用。。每个clk module的结构如图所示。。我希望pt能从source clk处开始check,但是希望clk group可以是clk1,clk2,clk3的名字，而不是source clk的名字。请问该如何设置clk才行？
这个clk module是我自己搭的clk gating.
谢谢