一个诡异的现象 calibre 做lvs到底是什么原理？？

Elaine1992 · 发表于 2017-10-29 14:45:27

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用calibre 做lvs，因为只有top gds，没有schematic，所以我先用calibre -spice 抽出layout netlist，然后拿这个layout netlist当作shematic，再做一遍lvs，但是lvs一直卡在了 Begin BIN Begin PRP，感觉像是要比对不成功，但是也一直没报error，不知道这到底是个什么鬼情况，lvs 作比较不是layout netlist 和 schematic 比吗？

夏雨123 · 发表于 2017-10-30 09:11:52

第一次听layout netlist。长见识了。 layout VS schematic

jueduilk · 发表于 2017-10-30 10:05:40

你的尝试挺有意思 layout的netlist 和 schematic的netlist格式是不同的你直接用calibre 比较应该会有问题吧

毛头小子 · 发表于 2017-10-30 10:29:38

用calibre可以从layout中导出一个sp文件，这个文件可以当做cdl用，当然也可以把这个文件转成schematic，但是前提是要保证之前的layout与cdl是一致的，否则不知道你这么做的意义是什么。

Elaine1992 · 发表于 2017-10-30 10:56:59

回复 4# 毛头小子

我其实是想抽RC参数，用calibre+starrc的flow，只用lvs做完，才能用starrc来抽，但是因为没有cdl，所以才想到用这个方式。我现在尝试了另外一个gds（这个有配套的cdl），然后用calibre -flatten-spice 抽出来layout netlist，和原始cdl来比，这两个网表不一致，是不是在lvs 比较的过程中并不是简单的两个网表在比较？

Elaine1992 · 发表于 2017-10-30 11:03:17

回复 3# juedui

我其实是想抽RC参数，用calibre+starrc的flow，只用lvs做完，才能用starrc来抽，但是因为没有cdl，所以才想到用这个方式。您刚才说这两个netlist 的格式不同是指？我看都是SPICE格式，还是说在lvs compare 这一步的时候对这两种netlist处理方式不同？在lvs log中，读入source 和 layout 之后，会有transform这一步，layout中的net 和 instance 数量就又不一样了，这一步又是干嘛的？

xingmem · 发表于 2017-10-30 14:15:21

回复 4# 毛头小子

同意你的说法

motofatfat · 发表于 2017-10-31 09:40:24

我也試過 LVS 應該 OK , 先手寫一個 inv 的 netlist
讓 layout 去比對 , 抓出 layout.sp 後改一下片頭片尾pin name
再用這個 netlist 來做 lvs 應該 OK

Elaine1992 · 发表于 2017-10-31 11:51:26

回复 8# motofatfat
我现在拿了一个小的gds来做实验，这个有cdl可以做对比，cdl和gds的lvs是可以过的。然后用-flatten的方式抽出layout.sp，但是发现抽出来的layout.sp 和原始cdl并不一致，layout.sp会多出很多二极管，再拿这个layout.sp去做lvs，依然不过。

akwl2011 · 发表于 2017-10-31 21:24:39

LVS抽取layout网表的时候会抽取出来许多寄生的diode，一般抽取的网表做LVS会OK，不太清楚为什么还不过。感觉抽取RC的时候不需要比对LVS，只需要把LVS文件中设为CCI flow，把RC的开关打开就可以，做LVS比对只是保证你的layout和schematic是一致的，还是需要抽出来的网表来做RC。这个可以问一下mentor的人

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