icc place_opt 后utilization暴增怎么回事

saicom · 发表于 2015-10-9 16:32:52

edi和icc方式不一样，但结果按道理不会差太多，看看两边参数的设定有什么不同

nguyenphucvy · 发表于 2017-4-19 12:41:51

thank a lot

wanglijlu123 · 发表于 2017-4-19 17:03:47

run place之前看看timing和drv的情况

xingyun666666 · 发表于 2017-4-20 14:46:27

回复 13# wanglijlu123

请问，一般place到cts利用率增加多少是一个正常的范围，CPU特殊的除外

lizy369 · 发表于 2017-9-25 11:19:38

我CTS做完之后利用率到92%，是不是很难做下去了？做之前就有87%左右了

sweetfish · 发表于 2017-10-16 21:36:17

preCTSopt的话理论上不会增加太多，主要原因可能是修fanout，或者是你时序实在卡太紧了。最简单的方法就是看增加的cell的pre-fix名字，一般都能找到原因。

online2010 · 发表于 2017-10-17 11:08:05

1. check STA with zero-interconnection model;
2. check DRV settings;
if 1 & 2 pass, check
3. synthesis method and margins
4. floorplan

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