电路设计是以电压为标准吗？

谁枫而飘 · 发表于 2016-4-3 09:31:54

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在设计电路的时候，举个例子吧？管脚SEL0上拉一个10K的电阻，导致管脚上的电压为3.0v。那如果我不上拉一个10k的电阻，随便接只要我保证电压为3.0V都可以。我这样理解对吗？

pengruojing · 发表于 2016-4-3 10:30:48

SEL0 是逻辑输入脚?如果是,就可以

谁枫而飘 · 发表于 2016-4-3 15:36:08

回复 2# pengruojing

输入，为1的时候上拉1K电阻；为0的时候下拉1k电阻

pengruojing · 发表于 2016-4-3 15:48:05

回复 3# 谁枫而飘
上下拉电阻取值通常在几k到几十K, 决定于输入管脚的阻抗,CMOS 输入阻抗很高.

谁枫而飘 · 发表于 2016-4-3 16:10:21

回复 4# pengruojing

手册上这样说的啊

越远 · 发表于 2016-4-5 08:50:06

上拉强度应该是指的电流吧！

老阮 · 发表于 2016-4-5 18:03:22

貌似是Altera FPGA的模式选择引脚吧。
最好按手册推荐的来，貌似有些引脚是推荐直接连接到电源和地的。
看一下datasheet。

t28user · 发表于 2016-4-5 20:28:32

FPGA每隻腳都有電流的限制，加個電阻可以限制電流過大。

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