电源电压下降后PLL由锁定变为失锁

sy888866 · 发表于 2016-1-29 11:05:21

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本帖最后由 sy888866 于 2016-1-29 16:49 编辑

最近做了一个简单的CPPLL，输入频率为32.768K的晶振，通过倍频得到1M/4M8/16M的频率，倍频数M可选。电源电压为3V时，工作正常，随着VDD下降，到达某个点后（一般1.9V左右），电路会失锁，例如VCO输出4M时，VC=1V，那么此时VC的抖动频率为1/2的参考频率，振幅约0.1V左右。，请问大家遇到过这种情况么？我自己尝试将带宽调小，或者调节CP电流，LPF参数等，都没能解决。
大家建议看看我可以从哪方面来修改？

补充：VDD只是在一个范围内会产生VC抖动，导致PLL频率失锁的现象。等VDD下降到一定值，又稳定了。

semico_ljj · 发表于 2016-1-29 14:08:13

什么工艺？
用什么实现的？

jiajie109 · 发表于 2016-1-29 15:20:21

可能正常工作的时候VC大于1.9V，VDD降到1.9V时，VCO的频率上不去。

lwjee · 发表于 2016-1-29 15:49:38

你应该是首先分析问题来自哪里。

fallangel · 发表于 2016-1-29 16:22:43

正常工作电压是多少？

sy888866 · 发表于 2016-1-29 16:27:18

回复 2# semico_ljj

0.18um，5V工艺。由于公司限制无法上图。

sy888866 · 发表于 2016-1-29 16:30:12

回复 3# jiajie109

你好，谢谢你的回复，距离，我配置分频数M=144,时，VCO输出=122*32.768K=4M,此时VC=1V（VDD=3V)，将VDD下降，到2V以下，VC开始抖动，周期为1/2的参考频率（32K那个），振幅大约0.1V。

sy888866 · 发表于 2016-1-29 16:30:59

回复 5# fallangel

你好，正常工作电压时3V。

jamesccp · 发表于 2016-1-29 16:31:27

电压范围那么宽，内部要做regulator

fallangel · 发表于 2016-1-29 16:33:46

难道电源是变化的吗？电源变化这么大,KV 自然变化也大。仿真下就知道了

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