Ring VCO 相位噪聲測試值較大

hunu_zyf · 发表于 2015-12-10 17:47:41

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設計48M Ring VCO 測試發現20Khz之前的噪聲比仿真要大許多，PLL使用32K作為基準，環路帶寬放在3KHz附近，這樣3KHz之后的VCO噪聲均體現在PLL輸出噪聲上了。請問造成VCO低頻噪聲大的原因是什么??? 已經使用干凈電源，結果還是一樣。
VCO_simulation:

VCO_simulation

Openloop_meas:

Openloop_meas

hughhuang · 发表于 2015-12-10 20:04:15

本帖最后由 hughhuang 于 2015-12-10 20:06 编辑

感觉你这个带宽不是3k啊，像是10k多一点。其实我也是新手，说的不对望指正。

waley · 发表于 2015-12-11 00:56:43

Device's Flicker noise

hunu_zyf · 发表于 2015-12-11 09:09:19

回复 2# hughhuang

Open measure圖片是開環測試VCO Phase noise的圖

hunu_zyf · 发表于 2015-12-11 09:21:16

回复 3# waley

There are some fliker noise parameter in model. I can get 1/f^3 phase noise curve.
You meas the silicon fliker noise is larger than model?

hunu_zyf · 发表于 2015-12-11 10:11:59

Open loop 測試數據來看 20Khz之前的phase noise突然增加，并且不符合VCO Phase noise計算值

hughhuang · 发表于 2015-12-11 15:58:01

PLL的开环单位增益带宽不就应该是闭环的-3dB带宽么？另外如何测 VCO的噪声呢？片子测试的时候可以把VCO和前面的电路分开么？

seu_novak · 发表于 2015-12-11 16:10:00

一般工艺厂商提供的flicker noise的model精准度在较低频偏处是有限制的吧怀疑几KHz及以下时 device model的flicker noise有偏差并且离散度较大并且ring oscillator对flicker noise上变频的抑制本来就很差据cadence FAE讲pss&pnoise仿真时output log中linewidth值以下时的phase noise仿真曲线并不很准确仅供参考。

luhua20 · 发表于 2015-12-13 22:15:51

多谢分享，正需要

hunu_zyf · 发表于 2015-12-18 10:48:42

回复 7# hughhuang

設計PLL時，有寄存器可以設置open loop和close loop，open loop時 VCO 的VCON信號可以從PIN外灌信號。

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