关于DC综合纯组合电路，求教。

pdsrazor · 发表于 2014-5-14 15:22:32

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我现在在做加减乘除之类的数学运算电路，是纯组合的，重点应该是在算法以及电路结构设计上。但是需要dc的实验结果。现在情况有些特殊，组合电路综合需要时钟吗？另外，我的代码没有always，if之类的语句，全部是用&，|，~之类的逻辑运算搭建起来的。我综合的是时候该如何使dc不进行优化，而直接map到工艺库然后得到延时和面积信息呢？
先谢谢大家。

pdsrazor · 发表于 2014-5-18 21:57:50

每次都秒沉。。

richardxingxing · 发表于 2014-5-19 09:40:15

max min delay

liyanyu_1987 · 发表于 2014-5-19 11:45:06

设计可以使用工艺库的门来完成，相当于手写的门级网标，然后将这些库射程dout_touch属性，在端口可以考虑使用set_max_delay set_min_delay这样的约束，

pdsrazor · 发表于 2014-5-19 13:01:40

回复 4# liyanyu_1987

还真要手写网表啊？，其实规模挺大的。另外dc的translate命令可以用吗。好像可以直接映射到工艺库。像我这种无需优化的情况还需要设置delay吗？可不可以直接report结果呢？

haimo · 发表于 2014-5-19 13:47:47

我觉得如果对延时和面积没有特别要求的话，就直接使用+，-，*，/。
根据你的约束条件，dc会自己选择合适的乘法器，加法器的。

pdsrazor · 发表于 2014-5-19 16:39:23

回复 6# haimo

感谢回复，我的老师是做这些运算电路研究的。也就是提出一些新的算法，或者电路结构等等。是专门搞这个的，所以加法，乘法，开方等等运算电路的结构都是自己手工搭建的。使用DC这些工具是想得到数据方便比较。

k00k · 发表于 2014-5-20 00:59:40

直接结构级描述吧

k00k · 发表于 2014-5-20 01:00:40

直接结构级描述吧

xmxn3559 · 发表于 2014-5-20 13:19:00

约束该怎么加呢能有啥约束呢

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