关于PLL和CDR

wpbuaa · 发表于 2012-11-26 14:25:48

回复 10# andy2000a

我还没看过论文，但是要是来个40G的时钟，估计我要去死了

andy2000a · 发表于 2012-11-26 14:49:09

本帖最后由 andy2000a 于 2012-11-26 14:58 编辑

USB3  PHY 內應該有  5Ghz  pll ..

40GHZ 是超過 process limit ?
先前不是有 60Ghz RF ..
不知道目前 55nm  Ft 多高?

IEEE PAPER

A 40-GHz phase-locked loop for 60-GHz sliding-IF transceivers in 65nm CMOS

40GHZ_80nm pub_isscc2006.pdf (411.69 KB , 下载次数: 68 )

75G_pll_90nm process.pdf (2.59 MB , 下载次数: 100 )

feynmancgz · 发表于 2012-11-26 14:58:23

回复 7# wpbuaa

你们有博士带吗？还是你就是博士搞这个？

andy2000a · 发表于 2012-11-26 15:02:03

回复 13# andy2000a

find more paper

40Gb Clock and Data Recovery.pdf (668.14 KB , 下载次数: 165 )

40gbps quarter rate CDR 90nm.pdf (712.83 KB , 下载次数: 106 )

40gbps data recovery_0.18um.pdf (3.75 MB , 下载次数: 116 )

google 都找得到上面 paper

wpbuaa · 发表于 2012-11-26 15:55:52

回复 11# andyfan

做的时候还算是认真的。。。

wpbuaa · 发表于 2012-11-26 15:56:44

回复 15# andy2000a

灰常感谢啊

wpbuaa · 发表于 2012-11-26 15:57:35

回复 14# feynmancgz

我只是一个小硕士而已~~

feynmancgz · 发表于 2012-11-26 17:09:42

回复 18# wpbuaa

没有博士带？那会很辛苦，而且很有难度～

wpbuaa · 发表于 2012-11-26 17:56:34

回复 19# feynmancgz

有个博士，不过这个师兄也才博三~

lwjee · 发表于 2012-11-26 20:47:32

回复 9# wpbuaa

CDR 主要就是PLL，搜PLL

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