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查看: 2133|回复: 5

[求助] 希望达人指导“时钟模块”设计,谢谢!

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发表于 2012-10-26 09:25:03 | 显示全部楼层 |阅读模式

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对于ASIC的时钟模块设计,本人不是非常了解,只知道一二,除了功能需求分频和倍频外,有什么注意的地方,

或者有一些什么规则和建议,希望大家给一些建议!
 楼主| 发表于 2012-10-26 10:51:01 | 显示全部楼层
顶一下,比如clock gate ,clock mux都应该怎么设计?
直接调用lib里面的cell例化吗?
发表于 2012-10-26 10:52:52 | 显示全部楼层
直接例化clock cell。
发表于 2012-10-26 11:07:14 | 显示全部楼层
同意樓上的話
 楼主| 发表于 2012-10-26 11:30:46 | 显示全部楼层
发表于 2012-11-1 23:11:47 | 显示全部楼层
clock_mux  需要glitch free的。。。网上能够搜到的!
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