hold 违例修不掉，怎么办？

龙溪小泮 · 发表于 2012-8-13 11:35:30

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时序路径如图

现在是有几条这两个时钟之间的hold违例，始终优化不掉，请问该怎么解决呀？

magic14 · 发表于 2012-8-13 12:06:53

uncertainty 0.5ns? 都已经是CTS之后了，这个值设得太大了吧？

龙溪小泮 · 发表于 2012-8-13 12:27:07

回复 2# magic14

CTS后，sdc中时钟的uncertainty一般设置多大呀？
CTS后，已经生成真实的时钟，这时重新导入的sdc中还需要在创建时钟吗？要创建的话，该怎么约束呀？

谢谢

yin_wt · 发表于 2012-8-13 13:55:30

回复 magic14

CTS后，sdc中时钟的uncertainty一般设置多大呀？
CTS后，已经生成真实的时钟 ...
龙溪小泮发表于 2012-8-13 12:27

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这个得根据你整个芯片的预算来算吧
比如说你时钟从PLL出来以后，到底有多少延时

cts以后就是传播时钟模型了(Propagated Model)

hdch121212 · 发表于 2012-8-14 23:16:11

这个要根据自己的设计以及目标来设置，uncertainty的设置会影响工具对时序的优化，怎么样设好，要分析

AveryYoung · 发表于 2012-8-15 09:38:14

uncertainty在post route的时候可以适当小一点，特别是给hold的值更要小，而且，这个uncertainty不是随便估计的，要根据你的pll jitter和其他因素来考量。

你的两个时钟int_clk和clk是同一个时钟域的么？如果是异步时钟，在约束里面不是要加set_false_path？

白兰地 · 发表于 2012-8-18 10:16:37

回复 6# AveryYoung

想请教您：如何确认设计里的两个时钟是什么关系？而且sdc里面两个时钟都是用creat_clock创建的时钟，做时钟树是要分开做吗？（用的工具是ICC）谢谢！！！！

AveryYoung · 发表于 2012-8-18 12:32:17

回复 7# 白兰地

如果是完全异步的时钟，就是毫无相位关系，那么是需要set_false_path的
而如果是毫无相位关系的时钟，CTS方面，应该是单独做，保证自己时钟域内的skew较小即可。

4169641 · 发表于 2012-8-23 19:30:30

一般uncertainty的设置 signoff 是有标准的。

小丫 · 发表于 2012-8-24 13:58:39

回复 6# AveryYoung

后端最后的hold violation有可能需要手工修正

[求助] hold 违例修不掉，怎么办？

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