后端面试--每日一题（017）

陈涛

giving the schematic and delay in attached picture, calculate theWC setup slack at D pin of F2, and BC hold slack at D pin ofF4
如图所示电路，时钟和延迟，计算WC下到F2输入端D的setup slack，BC下到F4输入端D的hold slack

难度：3

strivenbu

我算出的是：F2输入端D的setup slack是(8+0.5-0.3)-(0.7+7.0)=0.5
                  F4输入端D的hold slack是(0.2+0.2)-(0.2+0.2+0.1)=-0.1
setup都使用max值，hold都使用min的值
采用OCV模式的话，F2输入端D的setup slack是(8+0.2-0.3)-(0.7+7.0)=0.2
                            F4输入端D的hold slack是(0.2+0.2)-(0.5+0.5+0.1)=-0.7
我没有把握，只是想来验证一下自己的答案，因为对前面那个generator clock全当做clock latency处理了，data path和clock path的clock latency都一样，所以计算的时候都可以不考虑，只是时钟周期换成8了，
等待正确答案啊，呵呵

papertiger

OCV一般不这样设置，算10%的variation 的话， setup 也就是 8+ 0.5 -0.05 -0.3 -7.7 = 0.45 吧。

hold time 也成了 -0.14 吧

zzczx

嗯。 setup: 0.5 ,hold -0.1
二楼的，已经指明是bc，wc，你这个是过度回答，^_^

陈涛

因为没有给OCV的derating，所以计算时不用考虑OCV

strivenbu

回复 5# 陈涛


    呵呵 弱弱地问下derating是什么呀

zmn

嗯 同意2楼非OCV解答

陈涛

F2输入端D的setup slack是(8+0.5-0.3)-(0.7+7.0)=0.5
F4输入端D的hold slack是(0.2+0.2)-(0.2+0.2+0.1)=-0.1
strivenbu 发表于 2011-6-2 09:02

                               
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这个就是正确答案

chris_li

这个就是正确答案
陈涛 发表于 2011-6-2 15:20

                               
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大大， 恕晚辈冒昧，setup slack有异议，图中给出的clk的period是4ns， 非8ns， setup slack貌似不met！

chris_li

这个就是正确答案
陈涛 发表于 2011-6-2 15:20

                               
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大大， 恕晚辈冒昧，setup slack有异议，图中给出的clk的period是4ns， 非8ns， setup slack貌似不met！