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ISE综合后的仿真,在网上看到些乱起八爪的方法,大都是这样的:“后仿真总共需要3个*.v文件。一个是你的模块的测试文件,一个是ISE生成的xxx_translate.v(翻译产生的) (注意,我们要更改这个文件的文件名,改为 xxx.v,也就是你的顶层模块名了。)。另一个是glbl.v文件。这个文件在 Xilinx安装目录:Xilinx91i\verilog\src下”,按照这样的方法我的测试文件为test.v,顶层模块为dsp.v,然后我将综合后产生的文件_translate.v改名为我的顶层模快名dsp.v,然后将test.v,dsp.v ,glbl.v 加入到modelsim的工程中。在仿真的时候虽然能正常仿真,但原来顶层模块下的那些子模块无法显示出来,也就无法看里面各个信号的波形。即使去掉仿真中的优化功能也见不到子模块。
但modelsim做综合前的仿真没出现这样的问题。
请问是不是综合后仿真设置错了,网上能找到的都是这样做的,无解了。。。
这个问题搞了半天都没解决,悲催啊! |
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