关于时钟系统的设计请前辈指教

sqeen · 发表于 2010-7-5 09:04:37

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最近正在参与一款DSP的前期规划工作，从来没有搞过时钟系统，不知道从何做起，请前辈给点建议。
另外，关于低功耗的设计，要求时钟走线上减小功耗，提出用差分放大器差分走线实现时钟长距离传输的低功耗设计。请问有这方面的资料吗？请高人指点，谢谢了。

xuer_1975 · 发表于 2010-7-8 09:28:15

是要做一个DSP芯片吗，芯片的时钟要布时钟树。低功耗在时钟上门控。

jintian05 · 发表于 2010-7-11 10:32:15

降低功耗的常见设计做法：
1. 将各个模块的时钟分离开，可以在特定的工作模式下，将某些模块的时钟关掉。
2. 为各个模块选择合适的时钟频率，够用就好，不要偏高。
3. 在综合时采用clock gating技术，这需要写代码的时候，注意一下多加入一些门控信号。

gbsid · 发表于 2010-7-11 14:34:02

对系统时钟的几点考虑：
1、保证低功耗模式下能够正常处理时钟的起停
2、注意不相关时钟引起的时序问题（表现为setup与holdup时序问题）
3、在芯片的扫描连测试阶段可以将时钟进行屏蔽，全部通过一个时钟源给定
4、注意系统的运行频率
5、考虑锁相环的使用
6、注意各模块对时钟抖动的要求，尤其是adc...

sqeen · 发表于 2010-7-12 08:53:30

谢谢指教

songw · 发表于 2010-8-29 10:13:02

“提出用差分放大器差分走线实现时钟长距离传输的低功耗设计”，挺新颖的，多大设计，多长的时钟路径阿

angus1208 · 发表于 2010-10-13 11:05:50

thanks

sjjg · 发表于 2011-2-8 22:11:57

长距离传输？---芯片内还是芯片之间？

rvisk · 发表于 2011-4-10 10:38:20

楼主的议题很前卫

daijijia · 发表于 2011-4-11 16:31:50

回复 9# rvisk

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