Cadence Layout LNA 问题，请教高人

huhu_zsu · 发表于 2011-1-3 05:19:39

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cadence layout 画好LNA 电路。Export正常。
在别人的cadence上import gds 文件，电容的夹层就变了。再export, import，都是改变后的样子。这样，整个电路就废了。
别人的cadence 画一些基本MOS, BJT 正常，export, import gds file 也没有layer 被改变。
不知道怎么解决呢。
请高人指导。感激！