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[求助] astro布线时,怎样处理150多个32×18的ram?

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发表于 2010-11-1 11:31:01 | 显示全部楼层 |阅读模式

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本帖最后由 bboyxiaoyong 于 2010-11-1 11:32 编辑

verilog代码里用到了150多个32×18的ram,以前做astro布线时,一般只处理几个比较大的ram,直接手动摆放位置就行了,现在遇到这么多较小的ram,不知道怎么处理,不会还得手动放吧,想请教各位高手,能不能利用astro自动给这150多个ram摆放位置?
    或这么小的ram,如果不用memory compiler生成(较小的ram比较耗面积),能不能用别的方法代替生成呢?谢谢大家了~
发表于 2010-11-1 12:10:51 | 显示全部楼层
这么多啊,代码不能修改吗??
 楼主| 发表于 2010-11-1 14:58:38 | 显示全部楼层
回复 2# zh123456789


    改不了了,是一个关于ldpc编解码的代码,现在就只能硬着做下去
发表于 2010-11-1 15:37:35 | 显示全部楼层
那150多个也太麻烦了啊,怎样才能调整的时序和congestion比较理想呢。

用工具的flooplan试一试
发表于 2010-11-2 12:52:58 | 显示全部楼层
是否可以考虑先就ram本身进行,布线,完成后,然后再以块ram的形式代入设计。
 楼主| 发表于 2010-11-2 13:57:01 | 显示全部楼层
回复 5# ic_qiand

您的意思是把这150多个的相同的ram先布好线,再拼成一个大的块加到电路中?
 楼主| 发表于 2010-11-2 15:01:47 | 显示全部楼层
回复 4# zh123456789


    astro好像只能摆放standard cell,有什么办法让astro也能自动摆放这些小的ram?
 楼主| 发表于 2010-11-2 15:23:34 | 显示全部楼层
回复 5# ic_qiand
astro好像只能摆放standard cell,有什么办法让astro也能自动摆放这些小的ram,就是能不能把这些ram也做成standard cell的属性?
发表于 2010-11-2 15:46:43 | 显示全部楼层
本帖最后由 ic_qiand 于 2010-11-2 15:53 编辑




    这个应该也不难,也完全没有必要一定要把他们加上STD的属性。且不说不一定和你的STD CELL一样高,就算一样高可以放到ROW上,布完了,估计时序也糟糕得很。

    其实,RAM本来就是当做宏来摆放的。自己写Vlog的连接关系,然后布线一次线。比如说4个32X18的作为一个CELL,这个很简单。

    再以这个作为宏再迭代一次,那就是16个了,再一次就64个了,这样技术上没有任何难度。
发表于 2010-11-2 15:50:23 | 显示全部楼层
BTW,这样技术上没有任何难度,但是确实是个体力活儿,特别是最后改前端出来的NL的时候。

典型站着说话不腰疼地,呵呵…

但是总比满屏幕拖CELL,画ring 画blockage强吧?
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