SDRAM与DDR布线指南

shandongtou · 发表于 2010-7-9 15:41:56

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SDRAM与DDR布线指南
SDRAM是公共时钟同步模式，只关心建立时间，不关心保持时间。这些时间和各段飞行时间，经过各个门电路延时，clock skew，jitter，cycle等有关，需要按照公式精确计算。算出各种参数后下规则，让EDA软件辅助设计。选出最长的一根线，不需要计算什么，只要与之等长即可。有些软件能自己算，有些只能自己一段段计算，可以编程让EXCEL表格对某种格式的报告文件自动求和，也算半自动化了。

DDR的所有信号都要加匹配，不论多复杂，为了稳定性。
始端匹配串接一个22/33欧电阻即可，终端匹配分为AC匹配和DC匹配，阻容可以对噪点抑制，戴维宁电路可以提供高压输电，使参考电平更准确，虽然直流功耗大，但比单个50欧功耗小。
CPU和DDR都是高速器件，DDR热量高，应远离。而且DDR是源同步时钟模式，对保持时间有要求，不是线越短越好，有最小距离要求。保证时钟稳定，同频同相，冗余大即可。

有时，信号线有交叉的情况，此时，可以在PCB里调线，再反标回去，因为RAM的各个数据线不需要一一对应，只要有地方存储bit就可以了。注意：刷新线A10不能调，需要读取RAM ID时也不能调整。………………

白影 · 发表于 2010-7-9 20:19:59

mcchan · 发表于 2010-7-13 13:33:22

mcchan · 发表于 2010-7-13 13:34:52

mcchan · 发表于 2010-7-13 13:37:39

could you explain why need these document need separate to two files. because I found the two file is totally same!!! pls don't waste our money at same thing