Cell-based IC Design,Implementation and Verification_CIC講義

kevinwjs · 发表于 2008-3-10 13:48:47

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Design Flow Overview
Verilog at a Glance
RTL Simulation
Code Coverage Analysis
RTL Synthesis
Logic Synthesis
Gate-level Delay Calculation
Static Timing Analysis
Power Analysis & Optimization
DFT & ATPG
Automatic Physical Design
Physical Verification
Formal Equivalence Checking

idaty · 发表于 2008-3-22 02:02:36

Thanks for sharing.

blackwind · 发表于 2008-11-23 15:14:18

I gat it
Thx for sharing

garcia · 发表于 2009-5-13 03:29:01

gooooooooooooood

ziway · 发表于 2009-5-15 08:44:30

多謝分享

ziway · 发表于 2009-5-15 08:46:08

有兩個附檔阿～再推一下吧

ziway · 发表于 2009-7-16 19:10:15

thanks for sharing

ziway · 发表于 2009-7-16 19:11:24

thanks for sharing

ziway · 发表于 2009-7-16 19:12:38

thanks for sharing

hitpiano · 发表于 2009-9-15 01:37:51

好，谢谢
这个收藏

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