画PAD RING时，LVS报错

DabaiSky · 发表于 2025-8-30 16:36:34

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请问各位大佬，我在画IO RING和PAD RING的时候，分了好几个digital的gnd和analog的gnd，分别是VSS、AVSS、AVSS18,在画版图的时候是没有相互连接的，但是LVS提示warning，说三个net连接到了一起

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TCKG · 发表于 2025-8-30 21:00:02

软连接了，不同的地需要隔离

haydnzhang · 发表于 2025-9-1 08:34:49

加上一个识别层。

DabaiSky · 发表于 2025-9-1 09:04:46

haydnzhang 发表于 2025-9-1 08:34
加上一个识别层。

请问该在哪里添加呢不同的VSS上面吗，目前不了解是那种识别层

DabaiSky · 发表于 2025-9-1 09:06:09

TCKG 发表于 2025-8-30 21:00
软连接了，不同的地需要隔离

请问具体该如何解决呢新手不太懂这个

DabaiSky · 发表于 2025-9-1 09:11:17

TCKG 发表于 2025-8-30 21:00
软连接了，不同的地需要隔离

请问具体该如何操作呢，新手不太懂这些

wanchengchen · 发表于 2025-9-1 09:30:59

搜一搜有没有psub2这一层，把不同的地分开包一下就好

DabaiSky · 发表于 2025-9-1 09:38:12

wanchengchen 发表于 2025-9-1 09:30
搜一搜有没有psub2这一层，把不同的地分开包一下就好

直接把这一层标识层改在不同的VSS金属上吗

wanchengchen · 发表于 2025-9-1 09:45:28

DabaiSky 发表于 2025-9-1 09:38
直接把这一层标识层改在不同的VSS金属上吗

盖到不同地的模块上

王玉 · 发表于 2025-9-2 11:38:50

wanchengchen 发表于 2025-9-1 09:30
搜一搜有没有psub2这一层，把不同的地分开包一下就好

不同的工艺名字不一样的，不一定就就要psb2 有可能还叫subd或者sepgnd呢反正原理都是一样的就是为了骗lvs 验证，这个事虚拟的隔离，并不是物理上真正的隔离。

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