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一般一致性测试会以眼图为准，而眼宽可以通过抖动要求获得，所以该部分适合想要知道为甚么会有这样的眼图要求的人比较有用，如果不感兴趣，也可以忽略这繁琐的章节，只要知道眼图标准也能进行工程判断。 随机抖动是基于误码率的高斯分布，整个系统的抖动裕量的评估是在假设最小的随机抖动基础的前提下进行的（可能是因为随机抖动是高斯分布，测试时间无限的情况下，它会一直递增，是无限的，所以只能在最小值假设情况下进行）。 随机抖动Rj和确定性抖动Dj是可以进行均衡配置的，但是最终要保证总抖动Tj是满足要求的，其中Dj又可以分为周期性抖动Pj，数据相关抖动DDJ，一般DDJ又可以分为占空比抖动DCD和ISI。周期抖动一般是由外部确定的噪声耦合到系统重引起的，可能的抖动源如电源的EMI，扩频时钟SSC的调制信号等。DCD一般可能是信号的上升下降沿斜率不同或者信号DC值发生变化导致波形的判决门限高于或者低于应有值。ISI一般与码型相关比如连续的1或者0进行电平转换所需要的时间会比1010高频码型进行电平转换需要更多的时间，从而导致电平识别问题，增大误码率。 下表列举了2.5GT/S信号和5GT/S信号的整个系统的抖动裕量分配情况，对于8GT/S和16GT/S的信号系统，没有明确分离Rj和Dj的抖动数据，只对总的抖动有要求参见PCIE Base SPEC： 值得注意的是，虽然PCIE的误码率一般会要求到1E-12，但是如果仿真或者测试综合考虑时间成本和准确度的情况下，我们可能会选择跑的数据量为1E6，那么这个时候我们需要按照1E-6的抖动要求来进行判断抖动是否满足要求。 如果按照系统板（系统板的抖动需要包含金手指+连接器部分）+标卡的物理结构进行抖动裕量分配，可以按照下面的表格： UI = 400 ps for 2.5 GT/s, 200 ps for 5.0 GT/s,；125 ps for 8.0 GT/s ；62.5 ps for 16.0 GT/s; 这些抖动包含了串扰，反射等信息，与眼图的眼宽息息相关； 经验来讲，一般PCIE卡可以走线宽5mil的差分对，最长可以走4inch，如果超长或者线窄，还是以仿真结果为准；
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发表于 2025-5-18 21:28:45
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