CTLE设计求助

ttttttjc · 发表于 2025-4-16 12:11:38

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本帖最后由 ttttttjc 于 2025-4-16 12:19 编辑

如图是我的CTLE的原理图、搭建的testbench和仿真得到的ac增益，请问为什么中间会凹下去一部分？设计的工艺库是台积电的65nm，最终要求是在25GHz左右达到peak，相较于直流增益有3~12dB可调的peak增益。testbench中电源电压为1V，共模输入电压为0.7V，理想电流源的电流为75uA，输出的负载电容为60fF。

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YyuanRTs · 发表于 2025-4-16 13:55:33

怎么甚至有人试图在65nm做112G

Kurry123123 · 发表于 2025-4-16 14:01:25

两个零点太远了

ttttttjc · 发表于 2025-4-18 09:57:23

Kurry123123 发表于 2025-4-16 14:01
两个零点太远了

感谢回答！确实是零点有点靠后导致的。

ttttttjc · 发表于 2025-4-18 09:58:15

YyuanRTs 发表于 2025-4-16 13:55
怎么甚至有人试图在65nm做112G

要求是这样，我也觉得很难做到

张江板砖工头 · 发表于 2025-4-18 10:49:28

mmmmmm

自由引导人们 · 发表于 2025-4-19 23:12:54

集创赛嘛，我也是做这个，有点崩溃了

tomcourage2011 · 发表于 2025-4-20 20:33:20

电阻和电容要调节到合适的值。

jiaoda · 发表于 2025-4-23 09:18:11

你上面两个电感是想做T-coil吧，为啥没有耦合电容？出现凹槽，大概率是两个peaking没有调好，一个太低，一个太高，所以中间就掉下来了

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