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Riching 发表于 2025-3-12 18:05 simulink的结果应该是没引入非线性的影响吧
VCMOS 发表于 2025-3-12 19:47 开关和运放都是理想的,应该不会有非线性吧
Riching 发表于 2025-3-13 09:49 整个电路都是理想元件吗,电容也是理想的吗?
Riching 发表于 2025-3-13 09:53 可以检查一下运放输出有没有截顶或者输入信号建立不完全的情况
VCMOS 发表于 2025-3-13 14:16 电容是mim,其他都是理想
Riching 发表于 2025-3-13 17:26 那要不电容也用理想的试试,把理想开关导通阻抗设很低看看,这样RC建立应该就没问题。再者我就想不到什么 ...
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