TSMC .18工艺数字IO cell出现LUP.3.3g LUP.5.3g 错误（已解决）

Hyouka0129 · 发表于 2024-12-23 14:17:30

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本帖最后由 Hyouka0129 于 2024-12-24 00:39 编辑

如图，在做TSMC.18工艺数字后端时，在信号的IO cell中报了两个Latch Up错误，虽然是以g为后缀的，但老板觉得Latch up问题不能waive。

已经尝试过改DRC rule里识别PAD的选项，没有用。对着DR手册里看了一下，感觉报错也确实没问题。由于是库里的cell直接拿过来就报错，实在不知道怎么解决了，有没有好心人能够帮忙看一下qaq

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Hyouka0129 · 发表于 2024-12-24 00:38:18

好的已经解决了，决定waive掉，如果也有遇到的朋友也waive掉就行了，大家都是这么干的

u_pin9 · 发表于 2025-4-12 21:31:37

想请问楼主，上面那个ESD.24g 可以waive吗

Cribug2022 · 发表于 2025-4-14 11:07:17

带g是什么意思

Hyouka0129 · 发表于 2025-10-15 13:05:25

u_pin9 发表于 2025-4-12 21:31
想请问楼主，上面那个ESD.24g 可以waive吗

可以的

Hyouka0129 · 发表于 2025-10-15 13:06:15

Cribug2022 发表于 2025-4-14 11:07
带g是什么意思

Guideline的意思，DRC手册里说Guideline是推荐的Rule，满足了最好，不满足也行

wangYIRU0912 · 发表于 2025-11-24 02:53:11

天啊，我也是遇到这个问题，真是没招了，lup.5.3g也可以waive吗？这个可以通过调整io cell的距离来消除吧？关键是我是做模拟电路bgr的，代理商说没有analog io cell,让我用pvdd2ana 来做信号传输，就遇到了和你一模一样的问题。。。。请问你io cell 是紧密靠在一起的吗，有没有吧io cell 拉开一段距离？这样子可以消除部分lup

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